ADP5023ACPZ-R7

El ADP5023 combina dos reguladores reductores de alto rendimiento y un regulador de caída baja (LDO) para cumplir con los exigentes requisitos de rendimiento y espacio de la placa. La alta frecuencia de conmutación de los reguladores reductores permite componentes externos multicapa diminutos y minimiza el espacio de la placa. Cuando el pin MODE se establece alto, los reguladores reductores operan en modo PWM forzado. Cuando el pin MODE se establece bajo, los reguladores reductores funcionan en modo PWM cuando la corriente de carga está por encima de un umbral predefinido. Cuando la corriente de carga cae por debajo de un umbral predefinido, el regulador opera en modo de ahorro de energía (PSM) mejorando la eficiencia de carga ligera. La aplicación incluye energía para procesadores, ASIC, FPGA y conjuntos de chips de RF, instrumentación portátil y dispositivos médicos y dispositivos con limitaciones de espacio.

• Voltaje de salida ajustable, UVLO bajo, habilitado en el menú desplegable activo del canal reductor
• Programable de fábrica o ajustable externamente VOUTx
• Operación reductora de 3MHz con modos PWM forzado y PWM/PSM automático
• Rango de voltaje de salida BUCK1/BUCK2 de 0.8V a 3.8V
• Rango de voltaje de entrada de 2.3 a 5.5V (VAVIN = VIN1 = VIN2 = 2.3V a 5.5V, TA = 25 °C)
• El umbral es 150°C (típico, TJ en aumento, VAVIN = VIN1 = VIN2 = 2.3V a 5.5V, TA = 25 °C)
• La histéresis es de 20 °C (típico, TJ ascendente, VAVIN = VIN1 = VIN2 = 2.3V a 5.5V, TA = 25 °C)
• La lógica de entrada alta es 1.1V (mín., VAVIN = VIN1 = VIN2 = 2.3V a 5.5V, TA = 25 °C)
• La precisión del voltaje de salida varía de −1.8 a +1.8% (modo PWM, ILOAD1 = ILOAD2 = 0mA)
• Paquete LFCSP de 24 conductores, rango de temperatura de -40°C a +125°C

Notas

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